眼看Intel才剛為新一代處理器加入PCIe 5.0通道的支援，至今也上未見到到相關的設備投入市場，但負責制定PCIe通道規範的PCI-SIG(周邊元件互連特別興趣小組)就已經在早早在預備下一世代的標準，並在近日正式決定了PCIe 6.0的相關特色。


PCI-SIG表示，現今的通道速度成長速率大約維持著每隔三年就翻倍一次的周期，而他們很榮幸的能夠在PCIe 5.0規範推出後的三年內就完成了下一代PCIe 6.0的設計，新的PCIe 6.0通道將繼續著重在更具經濟效益的擴充解決方案，為資料中心、人工智慧學習、物聯網、自動設備等領域產生重大的影響，同時也兼具了「向下相容」的特性，保護過往的投資不會因此白費。



新的PCIe 6.0在設計上有以下幾個特點：
◆ 比PCIe 5.0通道高出2倍的頻寬，達到64 GT/s原始資料傳輸速度，相當於在x16介面下的傳輸量達256 GB/s
◆ 支援PAM4(四階脈衝振幅調變)訊號傳輸，與業界現有的PAM4標準相容。
◆ 支援FEC(Lightweight Forward Error Correct)、CRC(Cyclic Redundancy Check)校正功能，減少PAM4傳輸上的錯誤機率
◆ 基於Flit (flow control unit)的編碼將能夠支援PAM4調變，並FEC、CRC相結合，實現兩倍的頻寬。
◆ 更新Flit模式下的數據布局，以此提供更多功能並簡化處理。
◆ 可以相容過去的PCIe介面。


▲官方準備了PCIe 6.0介紹影片。

以PCIe 6.0的頻寬換算，x1介面就達到了16 GB/s之多，直接等於了PCIe3.0x16的介面頻寬，如此巨大的頻寬對於企業級應用來說自然是最喜聞樂見，不過這個規範就目前只能算得上超前部屬，要能夠實際應用，還是得等到A、I兩家處理器廠正式導入其支援功能且有相關周邊的推出才算數，以目前PCIe 5.0才在剛預熱的階段來看，快的話可能也要再等個4、5年才有機會了。


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